メーカーはすでに3D製造の120/128レイヤーナンドを計画しています

チップメーカーは、コスト競争力を高めるために、それぞれの120 層および128層3D NANDテクノロジーの開発を強化し、 2020年までにその飛躍を遂げる準備をしています。

120および128レイヤーの3D NANDモジュールはすでに処理中です

主要なNANDチップメーカーの一部は、 2020年前半に 128 層 チップのサンプルを 量産向けに提供していると、情報筋は述べています。 NANDフラッシュテクノロジーの価格の継続的な下落と、需要側の不確実性の高まりにより、製造業者はコスト上の理由から技術の進歩を加速しています。

SK Hynixは3月に96層4D NANDフラッシュのテストを開始しました 。東芝とWestern Digitalはすでに、トリプルレベルセル（ TLC）プロセス技術をベースに構築された128層技術を導入して、密度を高め、同じことを回避する計画を立てていました。現在のQLC （クワッドレベルセル）実装での時間パフォーマンスの問題。

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NANDフラッシュテクノロジーの市場価格の下落は、チップメーカーに収益性の問題を引き起こしています。 業界のリーダーであるSamsung Electronicsも例外ではありません。ベンダーのNANDフラッシュテクノロジービジネスの利益が大幅に減少し、ほぼ損益分岐点に達しているためです。

サムスンと他の主要なチップメーカーは、NANDフラッシュテクノロジーの価格を安定させることを目標に、2018年後半から減産を開始しましたが、64層3D NANDプロセスはすでにテクノロジーであるため、努力はほとんどうまくいっていません。情報筋によると、成熟し、在庫が大幅に増加している。

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